用Xilinx中的chipscope进行在线仿真，基本配置都完成了，但是最后没有抓到任何数据。有高手可以指点一下么

发布网友发布时间：2022-05-13 13:19

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热心网友时间：2023-10-10 14:27

“这里有一点，之前在生成CDC文件时，我选择的clock port也是和这个clk信号连接的，不知道这样会不会有问题？”
这个问题很严重：clk是时钟，不能抓自己。

.最后，我点击了 "run"（就是那个三角形按钮）去抓取数据，但是没有任何的sample 被抓到。
看看有没有说“Wait for Trg”如果有设置触发条件但是没有符合，一直等待。
如果说“slow or stopped clk”说明时钟没有正确接入或者根本没有时钟，仔细检查。追问谢谢，我已经修改了触发条件，也抓到了数据。但是出现了奇怪的问题。当我的测试设备仅仅上电，但是不让它正式工作时，可以抓到数据包。一但让设备正常工作（正常收发包），再次run，就抓不到数据了，上面显示slow or stopped clk，抓不到任何数据包。当我停止收发数据，让设备恢复到仅仅上电的阶段，仍然不能抓到数据，显示slow or stopped clk。这是为什么呢，难道是clk没有设置正确，如果没有设置正确，初始状态下为何能抓包

追答根据这个情况只能判定让设备正常工作的时候你那个抓取的CLK就会被禁用了。仔细查查吧。
是不是正常工作的时候的复位正负搞反了？