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verilog中 reg [255:0] a[1:0]就是说我定义了两个256位宽的寄存器吗?
发布网友
发布时间:2023-05-01 16:58
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热心网友
时间:2023-10-12 16:08
这个verilog语句的意思是你定义了寄存器a,这个寄存器是二维的数组,宽度是256,深度是2。
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